Absicherung FPGA-Basierter Systeme

Dieser Kurs vermittelt tiefgehendes Wissen zur Absicherung von FPGA-basierten Systemen, die in eingebetteten Anwendungen immer häufiger zum Einsatz kommen. FPGAs bieten durch ihre Flexibilität und Hardware-Beschleunigung viele Vorteile, stellen jedoch auch neue Sicherheitsrisiken dar. In dem Seminar werden aktuelle Angriffe wie Reverse Engineering, Seitenkanalangriffe und Fehlerangriffe auf FPGA-basierte Systeme detailliert behandelt. Es werden Schutzmaßnahmen für diese Angriffe sowie die sicherheitsrelevanten Features gängiger FPGA-Chips erläutert. Ziel ist es, den Teilnehmenden zu vermitteln, wie man FPGAs in eingebettete Systeme integriert und dabei die Sicherheit gewährleistet. Ein weiteres zentrales Thema des Kurses ist die Auswahl des geeigneten FPGA-Chips, um die nötigen Sicherheitsstandards zu erfüllen.

Durch praxisorientierte Beispiele lernen die Teilnehmenden, wie sie sichere Systeme entwickeln und die technischen Anforderungen für den Einsatz von FPGAs korrekt umsetzen. Der Kurs richtet sich an Architekt:innen und Entwickler:innen von eingebetteten Systemen sowie an Fachleute aus der IT-Sicherheit, die ihre Kenntnisse im Bereich FPGA-Sicherheit vertiefen möchten. Nach Abschluss des Seminars können die Teilnehmenden sichere FPGA-basierte Systeme entwerfen und Gegenmaßnahmen für verschiedene Angriffsarten anwenden. Der Kurs bietet zudem die Möglichkeit, sich mit Expert:innen aus der FPGA-Sicherheitsforschung auszutauschen.

 

Nach dem Seminar können Sie:

  • Aktuelle Angriffstechniken auf FPGAs wie Reverse Engineering und Seitenkanalangriffe verstehen.
  • Sicherheitsfunktionen von FPGA-Chips erkennen und effektive Gegenmaßnahmen anwenden.
  • Einen geeigneten FPGA für die Entwicklung sicherer eingebetteter Systeme auswählen und umsetzen.
ÜBERBLICK
Veranstaltungstyp
Präsenz-Seminar, Offenes Format, Inhouse-Format
Format
Präsenz
Abschluss
Teilnahmebescheinigung
Zugangsvoraussetzung
Idealerweise Grundlagen IT-Security und FPGA Design (optional werden diese vermittelt)
Termine, Anmeldefrist und Ort
  • 06.06.2025 in Garching bei München (Anmeldung bis 22.05.2025)
Dauer/ Ablauf
1 Tag Präsenz von 09:00 - 17:00 Uhr (bei Inhouse Veranstaltungen auch 2 Tage möglich)
Sprache
Deutsch
Teilnahmegebühr
600,00 Euro (USt. befreit gemäß §4 Nr. 22 Buchstabe a UStG)
Mehr infos
  • Das Seminar ist auf den Bedarf Ihres Unternehmens ausgerichtet, so dass der Inhalte und der Umfang in einem Vorgespräch unternehmensspezifischangepasst werden kann.
Veranstaltungsort
Fraunhofer-Institut für Angewandte und Integrierte Sicherheit AISEC, Lichtenbergstraße 11, 85748 Garching b. München
ZIELGRUPPE - dieses Seminar ist genau richtig für:
  • Architekt*innen und Entwickler*innen für eingebettete Systeme
  • Hardware-Architekt*innen und Entwickler*innen
  • Technische Leitungen in Entwicklungsprojekten
  • IT-Security Fachexpert*innen
KURSINHALTE - diese Themen erarbeiten Sie im Seminar:
  • Einführung und Marktanalyse FPGA
  • Angriffe auf FPGA
    • Reverse Engineering
    • Seitenkanalangriffe
    • Fehlerangriffe
  • Sicherheitskonzepte für FPGAs in Embedded Systemen
  • FPGA Auswahlkriterien
WEITERE INFORMATIONEN

In Kürze finden Sie hier noch weiterführende Informationen zu diesem Seminar.

IHRE TRAINER:INNEN

Dr. Nisha Jacob Kabakci

Nisha Jacob Kabakci erhielt einen BEng. in Telekommunikation an der Visvesvaraya Technological University in Bangalore, Indien. Sie hat einen MSc. in Embedded Systems Design am Advanced Learning and Research Institute der Universität Lugano, Schweiz, abgeschlossen (in Zusammenarbeit mit der ETH Zürich und dem Politecnico di Milano). Während dieser Zeit arbeitete Frau Jacob in der Forschungsgruppe für Kodierung und Kryptografie an der Nanyang Technological University in Singapur mit Schwerpunkt auf der effizienten Implementierung von kryptografischen Kernen. Seit November 2012 arbeitet sie als wissenschaftliche Mitarbeiterin am Fraunhofer Institut für Angewandte und Integrierte Sicherheit (AISEC). Hier ist sie an der Entwicklung sicherer Lösungen für eingebettete Systeme und an Sicherheitsevaluationen auf Systemebene beteiligt. Ihre Forschungsschwerpunkte sind Hardware-Trojaner und FPGA-Sicherheit.

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Kontakt

Ansprechpartnerin Fachliches

M.Sc. Nisha Jacob Kabakci

 

Fraunhofer AISEC

Telefon +49 89 3229986-116

 

 

Ansprechpartner Organisation und Anmeldung

Adem Salgin


Fraunhofer Academy

Telefon +49 89 1205-1555